64 bit 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC

결과: 9
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최고 작동온도
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Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
5재고 상태
최소: 1
배수: 1

DSPs ARM Cortex A5, SHARC+ 3 Core 500 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT - 40 C + 85 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
13재고 상태
최소: 1
배수: 1

DSPs ARM Cortex A5, SHARC+ 3 Core 450 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT - 40 C + 85 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
5재고 상태
최소: 1
배수: 1

DSPs ARM Cortex A5, SHARC+ 3 Core 300 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT - 40 C + 100 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
11재고 상태
최소: 1
배수: 1

DSPs ARM Cortex A5, SHARC+ 3 Core 450 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT - 40 C + 100 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
비재고 리드 타임 10 주
최소: 17
배수: 17

DSPs ARM Cortex A5, SHARC+ 3 Core 300 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT - 40 C + 85 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
비재고 리드 타임 10 주
최소: 1
배수: 1

DSPs ARM Cortex A5, SHARC+ 3 Core 500 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT - 40 C + 95 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
비재고 리드 타임 10 주
최소: 19
배수: 19

DSPs ARM Cortex A5, SHARC+ 3 Core 300 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT 0 C + 70 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
비재고 리드 타임 10 주
최소: 17
배수: 17

DSPs ARM Cortex A5, SHARC+ 3 Core 450 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT 0 C + 70 C Tray
Analog Devices 디지털 신호 프로세서 및 컨트롤러 - DSP, DSC Dual-core SHARC+ (w/768KB L1), arm Cortex-A5, 1MB Shared L2, DDR, Gigabit Ethernet, USB, SDIO, 400-cspBGA
데이터시트
비재고 리드 타임 11 주
최소: 15
배수: 15

DSPs ARM Cortex A5, SHARC+ 3 Core 500 MHz BGA-400 32 kB, 2 x 384 kB 32 kB, - 1.15 V ADSP-SC573 SHARC+ SMD/SMT 0 C + 70 C Tray